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Verification by Error Modeling: Using Testing Techniques in Hardware Verification 著者: Katarzyna Radecka; Zeljko Zilic 出版 Springer. 以下のデジタルおよびeTextbook ISBNs: Verification by Error Modeling : 9780306487392, 030648739X および 印刷版のISBNは 9781441954022, 1441954023. VitalSource でデジタル化することで、印刷に比べて最大 80% 節約できます。 この eTextbook の追加の ISBN には次のものがあります: 9781402076527.
